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debug-tb
Debug SystemVerilog testbench failures in the SVC project. Use when a testbench fails (make _tb), to analyze CHECK_* assertion failures, watchdog timeouts, or unexpected signal values. Provides systematic debug...
pbozeman AI Skills
GitHub ↗Explorez les skills IA publiés de pbozeman et consultez leurs instructions source.
Statistiques de l’auteur
Skills indexés
7Étoiles des dépôts des skills indexés
0Forks du dépôt
0Moyenne des étoiles par skill indexé
0Les étoiles d’un dépôt peuvent se répéter entre ses skills.
Catégories populaires
Indexation récente
Explorer
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adding-formal
Provides ASSERT/ASSUME macro pattern, .sby file template, and f_past_valid usage. Triggers when adding formal verification or writing assertions.
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writing-sv
Provides SVC naming conventions, comment style, code structure order, and reset patterns. Triggers when writing or modifying any .sv file.
GitHub
writing-module
Provides module template with include guard, port ordering, and checklist. Triggers when creating a new svc_ module from scratch.
GitHub
writing-tb
Provides svc_unit.sv testbench framework, macros (TEST_CLK_NS, CHECK_EQ, etc.), and template. Triggers when creating or modifying _tb.sv files.
GitHub
implementing-valid-ready
Provides SVC-specific valid/ready streaming interface patterns and common pitfalls. Triggers when implementing valid/ready handshakes or debugging backpressure issues.
GitHub
implementing-axi
Provides SVC-specific AXI/AXI-Lite naming conventions, signal ordering, and available modules. Triggers when implementing AXI or AXI-Lite interfaces.
Le classement utilise les étoiles du dépôt GitHub indexé. Plusieurs skills peuvent partager ce nombre : ce n’est ni un nombre d’installations ni une note de qualité.